Pspice仿真電路不能過大如何解決
在EDA學習中我們一定碰到過Pspice仿真電路不能過大的問題,那麼怎麼解決呢?下面YJBYS小編為大家整理了相關信息,希望對你有所幫助。
如何解決Pspice仿真電路不能過大的問題?
PSPICE仿真的是理想環境,除非你自己將一些寄生參數定義到迴路中,所以RC過大或過小也不會計算到寄生參數中。
您這個問題有兩個可能,但兩種都是因為時間的關係:
1。因為RC振盪電路有一個關鍵參數就是響應時間和振盪頻率,所以如果過大,響應時間太長或太短,導致在給定的時間裏面沒有響應或者太短而響應的圖像不明顯;
2。就是你在設置模擬參數(EDIT SIMULATION),就是你在放觸筆之前要編輯的一個模擬環境,那裏有設置響應時間,如果不能將那個時間跟RC響應時間對應,就不能顯示圖像。(看不太清您的圖,不過猜測應該是您設置的時間太長了,如果您原來是響應1S,您可以試着改成10ms,因為看圖片在零點那個位置好像有個脈衝)
所以如果您不改RC值,但是在設置模擬參數那裏修改起始時間,保持時間......一樣能實現圖形的輸出的。
運行Cadence16.2的Allegro PCB Editor時,在Setep→Use Preferences時出現以下提示對話框:"No match found for 'my_favorites' in the search path ."
忽略後,改變Allegro PCB Editor工作時的環境變量(例如padpath、psmpath路徑等),再保存的`時候出現以下對話框:"changes not saved, cannot update the env file"
問題原因:
在軟件安裝時,需指定Cadence的工作路徑/HOME位置。若不採取軟件默認設置,則需要人為修改系統變量home。出現該錯誤,就是因為指定的工作路徑與系統變量home值不符!
解決方法:
將pcbenv文件夾換一個位置,同時修改系統變量home的值即可。
1. 找到pcbenv文件夾(一般位於C:documents and settingsuser中)
2. 將其cut到某位置,如Cadence的安裝路徑
3. 右擊我的電腦→屬性→高級→環境變量,更改系統環境變量裏home的值,將此值設為絕對路徑,指向pcbenv文件夾,例如E:program_filesCadence
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